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Este livro centra-se principalmente na investigação na área recente do algoritmo de segurança de redes e na sua conceção optimizada no domínio da otimização de área. Este livro destina-se a uma vasta gama de leitores que beneficiarão de uma compreensão do algoritmo AES e do seu processo global associado à implementação de software VHDL no dispositivo FPGA da Xilinx. Inclui estudantes e profissionais no domínio do processamento e comunicação de dados, projectistas e implementadores e clientes e gestores de redes e comunicação de dados. Este livro foi concebido para ser autónomo, para leitores…mehr

Produktbeschreibung
Este livro centra-se principalmente na investigação na área recente do algoritmo de segurança de redes e na sua conceção optimizada no domínio da otimização de área. Este livro destina-se a uma vasta gama de leitores que beneficiarão de uma compreensão do algoritmo AES e do seu processo global associado à implementação de software VHDL no dispositivo FPGA da Xilinx. Inclui estudantes e profissionais no domínio do processamento e comunicação de dados, projectistas e implementadores e clientes e gestores de redes e comunicação de dados. Este livro foi concebido para ser autónomo, para leitores com poucos ou nenhuns conhecimentos de algoritmos criptográficos.
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Autorenporträt
Prof. H.S.Deshpande, werkzaam als assistent-professor in S.K.N.Sinhgad college of Engineering, voltooide zijn ME (Electronics Engineering) met een project gebaseerd op geoptimaliseerde implementatie van netwerkbeveiligingsalgoritmen in FPGA. De optimalisatie is gedaan op het gebied van vermindering van het aantal segmenten door bij voorkeur gebruik te maken van de statische RAM-structuur in de CLB's van de FPGA.