Optimização de Potência em circuitos de Routing FPGA - Muthusamy, Sundar Prakash Balaji
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O trabalho optimiza a potência em 4T,5T,6T,7T,8T,9T e 10T SRAM, comparando as suas configurações. São propostas duas operações baseadas em modo: operação Modo I e operação Mode-II. É proposta uma SRAM de 10T baseada no circuito de escrita do driver e a comparação de Potência Estática, Dissipação de Potência Estática, Métricas de Desempenho como Produto de Retardamento de Potência e Produto de Retardamento de Energia são comparados utilizando o TANNER 7.0. No futuro, os circuitos de trabalho de lógica Adiabatic têm de ser implementados e os resultados têm de ser obtidos.

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Produktbeschreibung
O trabalho optimiza a potência em 4T,5T,6T,7T,8T,9T e 10T SRAM, comparando as suas configurações. São propostas duas operações baseadas em modo: operação Modo I e operação Mode-II. É proposta uma SRAM de 10T baseada no circuito de escrita do driver e a comparação de Potência Estática, Dissipação de Potência Estática, Métricas de Desempenho como Produto de Retardamento de Potência e Produto de Retardamento de Energia são comparados utilizando o TANNER 7.0. No futuro, os circuitos de trabalho de lógica Adiabatic têm de ser implementados e os resultados têm de ser obtidos.
Autorenporträt
Dr. Sundar Prakash Balaji erwarb seinen Doktortitel an der Anna University, Chennai. Er besitzt einen Bachelor- und einen Master-Abschluss der Anna-Universität, Chennai. Derzeit arbeitet er als außerordentlicher Professor am RVS Technical Campus - Coimbatore. Seine Interessen liegen in den Bereichen Low Power VLSI Design, ASIC Design und Solid State Devices.