Riduzione dei circuiti logici digitali

Riduzione dei circuiti logici digitali

Un approccio basato su un diagramma decisionale binario

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Al giorno d'oggi, i progettisti di circuiti logici digitali cercano di ottenere la massima precisione possibile per i circuiti progettati con il minimo tempo consumato e, infine, con il minimo sforzo possibile. Il superamento di tutti questi vincoli non può essere ottenuto con gli approcci tradizionali, anche quando si utilizzano le Karnaugh-Maps, soprattutto quando si utilizzano più di 4 variabili in ingresso. Il problema più importante che i progettisti devono affrontare è quello di selezionare quali e come sono possibili le soluzioni ottimali, tenendo conto dell'ordine delle variabili p...