Towards High-Performance and Energy-Efficient Memory Hierarchy
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UVP
59,00 €
inkl. gesetzl. MwSt.,
Beschreibung
Produktdetails
Einband
Taschenbuch
Erscheinungsdatum
17.12.2012
Verlag
Scholars' PressSeitenzahl
132
Maße (L/B/H)
22/15/0,9 cm
Gewicht
215 g
Sprache
Englisch
ISBN
978-3-639-51013-3
Chip MultiProcessors (CMPs) are becoming the de facto hardware architecture over a range of computing platforms. According to Moore's law, the number of cores in CMPs is expected to keep growing as transistor density continues to shrink. As the number of cores increases, the complexity and trade-offs of current CMP design shift towards the uncore part of the chip. In this book, we discuss several approaches to improve the performance and energy efficiency of uncore components at major levels of the uncore subsytem such as the Last Level Cache (LLC) and the interconnect.
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