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Synthesizable VHDL Design for FPGAs (eBook, PDF)
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Eduardo Augusto Bezerra
Djones Vinicius Lettnin
Synthesizable VHDL Design for FPGAs (eBook, PDF)
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eBook, PDF
21. Oktober 2013
Springer International Publishing
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Gebundenes Buch95,99 €
Verification of Temporal Properties in Embedded Software
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Djones Vinicius Lettnin
Verification of Temporal Properties in Embedded Software
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Broschiertes Buch
based on Assertion and Semiformal Verification Approaches
9. November 2009
Südwestdeutscher Verlag für Hochschulschriften
Synthesizable VHDL Design for FPGAs
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Eduardo Bezerra
Djones Vinicius Lettnin
Synthesizable VHDL Design for FPGAs
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Broschiertes Buch
Softcover reprint of the original 1st ed. 2014
27. August 2016
Springer / Springer International Publishing / Springer, Berlin
978-3-319-37733-9
Synthesizable VHDL Design for FPGAs
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Eduardo Augusto Bezerra
Djones Vinicius Lettnin
Synthesizable VHDL Design for FPGAs
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Gebundenes Buch
2014
31. Oktober 2013
Springer / Springer International Publishing / Springer, Berlin
86280349,978-3-319-02546-9

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