Estudio escalabilidad en implementaciones hardware en cuerpos finitos
Aritmética cuerpos finitos en hardware reconfigurable
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Implementación de la aritmética de cuerpos finitos en hardware reconfigurable. El objetivo principal de la tesis se ha conseguido construyendo un nuevo algoritmo escalable de multiplicación en cuerpos finitos (del tipo GF(2m)). El algoritmo escalable propuesto ha sido diseñado en hardware reconfigurable. Para este algoritmo se presenta un diseño mixto hardware-software de un multiplicador para cuerpos finitos binarios.
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